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6 Reference Information
SAM4S ER-380 SERIES 6-3
6-1 Semiconductor Base Diagram
6-1-2 Memorys
Figure 6-1 SRAM K6T1008C2E Specification
Figure 6-2 SRAM K6T4008C2E Specification
PIN DESCRIPTION
Pin Name Function
WE
Write Enable Input
CS
Chip Select Input
OE
Output Enable Input
A
0
~A
18
Address Inputs
I/O
1
~I/O
8
Data Inputs/Outputs
Vcc Power
Vss Ground
FUNCTIONAL BLOCK DIAGRAM
32-DIP
32-SOP
(Forward)
32-TSOP2
A16
A14
A12
A7
A6
A5
A4
A3
A2
A1
A0
I/O1
I/O2
I/O3
VSS
VCC
A15
WE
A13
A8
A9
A11
OE
A10
CS
I/O8
I/O7
I/O6
I/O5
I/O4
32
31
30
29
28
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24
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21
20
19
18
17
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
32-TSOP2
A16
A14
A12
A7
A6
A5
A4
A3
A2
A1
A0
I/O1
I/O2
I/O3
VSS
VCC
A15
WE
A13
A8
A9
A11
OE
A10
CS
I/O8
I/O7
I/O6
I/O5
I/O4
32
31
30
29
28
27
26
25
24
23
22
21
20
19
18
17
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
(Reverse)
A18
A17
A17
A18
Precharge circuit.
Memory array
1024 rows
512×8 columns
I/O Circuit
Column select
Clk gen.
Row
select
I/O
1
Data
cont
Data
cont
I/O
8
CS
WE
OE
Control
logic
PIN DESCRIPTION
Name Function
CS
1, CS2 Chip Select Input
OE
Output Enable Input
WE
Write Enable Input
I/O
1~I/O8 Data Inputs/Outputs
A
0~A16 Address Inputs
Vcc Power
Vss Ground
NC No Connection
FUNCTIONAL BLOCK DIAGRAM
Precharge circuit.
Memory array
1024 rows
128×8 columns
I/O Circuit
Column select
Clk gen.
Row
select
I/O1
Data
cont
Data
cont
I/O8
CS1
WE
OE
CS2
Control
logic
A11
A9
A8
A13
WE
CS2
A15
VCC
NC
A16
A14
A12
A7
A6
A5
A4
OE
A10
CS
1
I/O8
I/O7
I/O6
I/O5
I/O4
VSS
I/O3
I/O2
I/O1
A0
A1
A2
A3
Type1-Forward
32
31
30
29
28
27
26
25
24
23
22
21
20
19
18
17
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
NC
A16
A14
A12
A7
A6
A5
A4
A3
A2
A1
A0
I/O1
I/O2
I/O3
VSS
VCC
A15
CS2
WE
A13
A8
A9
A11
OE
A10
CS
1
I/O8
I/O7
I/O6
I/O5
I/O4
32
31
30
29
28
27
26
25
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23
22
21
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19
18
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1
2
3
4
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7
8
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11
12
13
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15
16
32-DIP
32-TSOP
32-SOP
Column Address
Raw
Address
A4
A5
A6
A7
A12
A14
A16
NC
VCC
A15
CS2
WE
A13
A8
A9
A11
A3
A2
A1
A0
I/O1
I/O2
I/O3
VSS
I/O4
I/O5
I/O6
I/O7
I/O8
CS1
A10
OE
Type1-Reverse
17
18
19
20
21
22
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16
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8
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5
4
3
2
1
32-TSOP
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